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Xilinx FPGA平臺DDR3設(shè)計(jì)保姆式教程(六)

C29F_xilinx_inc ? 來源:賽靈思 ? 作者:賽靈思 ? 2022-02-26 17:34 ? 次閱讀
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實(shí)驗(yàn)?zāi)康模?/p>

為了更方便的對DDR讀寫,我們對DDR再次封裝成可復(fù)用的讀寫模塊。

一、前言

因?yàn)镈DR3是半雙工,所以DDR讀寫模塊應(yīng)該包括三部分內(nèi)容:

ddr3_top.v :

1. ddr3讀操作子模塊

2. ddr3寫操作子模塊

3. ddr3讀/寫仲裁模塊

但是在實(shí)際項(xiàng)目使用時,DDR都要根據(jù)實(shí)際需求來進(jìn)行讀寫操作,所以本文旨在提供一種思路,將讀/寫/仲裁合在一個模塊,實(shí)際使用當(dāng)結(jié)合具體情況而定。

實(shí)現(xiàn)目標(biāo): 給出(寫請求、寫長度、寫數(shù)據(jù)、寫地址)就寫入ddr3,給出(讀請求、讀長度、讀地址)就從ddr3讀相應(yīng)數(shù)量的數(shù)據(jù)出來。

二、方案設(shè)計(jì)

2.1 系統(tǒng)框圖

Xilinx FPGA平臺DDR3設(shè)計(jì)保姆式教程(六)

2.2設(shè)計(jì)狀態(tài)機(jī)

Xilinx FPGA平臺DDR3設(shè)計(jì)保姆式教程(六)

2.3代碼實(shí)現(xiàn)

代碼都是浮云~

記得帶我入門的老師傅說過:只寫代碼,那是碼農(nóng)干的~

重點(diǎn)是方案,是思路~

2.4仿真驗(yàn)證

寫入200個數(shù),1-200;

讀出100個數(shù),1-100;

驗(yàn)證成功。

三、其他

本章寫的比較簡略,主要參考黑金教程而來。實(shí)際使用正如文章開始所說,視具體情況而定。

1. ddr讀寫大都以FIFO作銜接,方便操作;

2. 讀寫操作按照時序圖操作就ok,主要設(shè)計(jì)讀寫仲裁方案。

3.1后記

本章確實(shí)寫的比較簡陋,原因一是使用情況具體分析;二是時間耽擱太久了,還有很多東西需要學(xué)習(xí);先把DDR放一放,后面有更深的理解的時候再來補(bǔ)充。

DDR3系列算是筆者第一個完整的系列文章,整理的同時順便加深自己理解,有點(diǎn)愛上寫博客了~

終于結(jié)束這個篇章了,這周末開始GTX接口系列文章的整理!

審核編輯:湯梓紅

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