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如何在同一塊開(kāi)發(fā)板上測(cè)試GT遠(yuǎn)端環(huán)回

XILINX開(kāi)發(fā)者社區(qū) ? 來(lái)源:XILINX開(kāi)發(fā)者社區(qū) ? 2025-01-08 16:02 ? 次閱讀
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環(huán)回(loopback)是 GT 的一種特殊配置模式。可以把發(fā)送端的數(shù)據(jù)直通過(guò)自身 PMA 層或?qū)Ψ狡骷ú患舆M(jìn)一步處理)后再轉(zhuǎn)回給發(fā)送器件的接收端,并校驗(yàn)是否有誤碼。這種工作方式可以檢驗(yàn) GT 配置是否正常,外部鏈路信號(hào)質(zhì)量等。在比較復(fù)雜的斷鏈場(chǎng)景下一般作為一個(gè)基本的調(diào)試定位手段。

環(huán)回分為近端(Near-End)環(huán)回和遠(yuǎn)端(Far-End)環(huán)回。具體介紹可以參考 AM01, CH2。

https://docs.amd.com/r/en-US/am017-versal-gtm-transceivers

近端環(huán)回比較常用且方便,遠(yuǎn)端環(huán)回則需要兩個(gè)獨(dú)立的器件來(lái)通信。AMD 的開(kāi)發(fā)板一般只有一塊 FPGA 或者 AMD Versal Adaptive SoC 芯片,做遠(yuǎn)端環(huán)回測(cè)試的話需要把兩塊開(kāi)發(fā)板對(duì)接起來(lái),并且保證兩塊板子的時(shí)鐘同源。本文我們介紹一種用一塊開(kāi)發(fā)板測(cè)試遠(yuǎn)端環(huán)回功能的辦法。

以 Versal VPK120 開(kāi)發(fā)板為例。其上包含一塊 VP1202 的芯片,可用 GT Quad 如下:

https://www.xilinx.com/products/boards-and-kits/vpk120.html

dedd710e-cce7-11ef-9310-92fbcf53809c.png

示例選擇 Quad 203 來(lái)模擬發(fā)送端器件。查看https://docs.amd.com/r/en-US/ug1568-vpk120-eval-bd

QSFP-DD1 和 QSFP-DD2 的連接關(guān)系如下:

可以看到 Q203 的 ch0 和 Q204 的 ch1 可以對(duì)應(yīng)連通。選擇 Quad 204 模擬作為接收端器件,使用 DAC 電纜線對(duì)接兩個(gè) QSFP-DD。

def11e66-cce7-11ef-9310-92fbcf53809c.png

Step 1:

在 AMD Vivado Design Suite 2024.1 里面建立測(cè)試工程。因?yàn)槭悄M兩個(gè)不同器件,這里分別用不同的 gt_bridge 去控制兩個(gè) Quad。Create Block Design, 里面添加兩個(gè) gt_bridge 和兩個(gè) gt_quad_base。在 gt_bridge 里面選擇好協(xié)議如下 (可按自己需要選擇):

df15bcda-cce7-11ef-9310-92fbcf53809c.png

使用 Run Block Automation – Customized_Connections, 自動(dòng)化連線:

df35653a-cce7-11ef-9310-92fbcf53809c.png

df4a5f12-cce7-11ef-9310-92fbcf53809c.png

自動(dòng)化連線結(jié)果如下:

df6da68e-cce7-11ef-9310-92fbcf53809c.png

Step 2:

遠(yuǎn)端環(huán)回需要兩個(gè)器件使用同源時(shí)鐘,我們把 Quad 203 和 204 的 REFCLK 修改為同一個(gè)。另外去掉該基本測(cè)試?yán)锩娌槐匾?IO 控制,只保持 GT serial ports 即可。

驅(qū)動(dòng)控制邏輯所需的 apb3clk,可以用 CIPS 來(lái)產(chǎn)生:

df9a4cb6-cce7-11ef-9310-92fbcf53809c.png

修改后的 Diagram 如下:

dfb4a8a4-cce7-11ef-9310-92fbcf53809c.png

保存,生成 HDL wrapper。

Step 3:

根據(jù) VPK120 開(kāi)發(fā)板的設(shè)置,添加 REFCLK 和 GTM 位置約束:

dfe1a368-cce7-11ef-9310-92fbcf53809c.png

接下來(lái)按普通流程生成下載文件 pdi 即可。

Step 4:

將 VPK120 的 SW1 設(shè)置為 0000 (JTAG),啟動(dòng)并下載 pdi 文件。

Step 5:

按照剛才對(duì)照的硬件連接關(guān)系,在 Serial I/O Links 中建立鏈:

e0031034-cce7-11ef-9310-92fbcf53809c.png

選擇自己想要測(cè)試的 PRBS pattern,設(shè)置第一個(gè) Link Q204 ch1. RX 為 Far-End PMA 模式,Q203 ch0.RX 為None(由于此處雙向通信,兩個(gè) Link 的設(shè)置可以互換)。此時(shí) Q204 作為了遠(yuǎn)端執(zhí)行環(huán)回的器件,Q203 則是發(fā)送端器件。這樣就模擬了兩個(gè)器件以遠(yuǎn)端環(huán)回對(duì)接的連接方式:

e0292490-cce7-11ef-9310-92fbcf53809c.png

設(shè)置 TX Main-Cursor;如果外部 Cable 插損比較大,還可以針對(duì)性調(diào)節(jié)其他 TX Cursor:

e047fc62-cce7-11ef-9310-92fbcf53809c.png

分別復(fù)位兩個(gè) Link。之后在 IBERT GTM Real-Time Scan Plots 的眼圖里面,可以看到通信已經(jīng)建立起來(lái):

e06b179c-cce7-11ef-9310-92fbcf53809c.png

應(yīng)用此文的辦法,可以在有限的實(shí)驗(yàn)室環(huán)境下做針對(duì) Far-End PMA/PCS Loopback 的一些特性測(cè)試和觀察,方便進(jìn)一步學(xué)習(xí)。

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原文標(biāo)題:開(kāi)發(fā)者分享|如何在同一塊開(kāi)發(fā)板上測(cè)試 GT 遠(yuǎn)端環(huán)回

文章出處:【微信號(hào):gh_2d1c7e2d540e,微信公眾號(hào):XILINX開(kāi)發(fā)者社區(qū)】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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