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Cadence在CES 2026成功演示3nm eUSB2V2 PHY IP解決方案

Cadence楷登 ? 來源:Cadence楷登 ? 2026-04-16 15:48 ? 次閱讀
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本文翻譯轉(zhuǎn)載于:Cadence Blog

作者:DavidShin

沒有什么比一套真實可用的系統(tǒng)更能建立信任。

這正是我們在拉斯維加斯 CES 2026 展會上展示的核心理念 ——我們成功演示了業(yè)內(nèi)首創(chuàng)的 3nm eUSB2V2 PHY IP,并與 eUSB2V2 控制器 IP 在完整的端到端系統(tǒng)中協(xié)同運行。最終實現(xiàn)了實時、真實場景下的 eUSB2V2 數(shù)據(jù)通路,傳輸速率高達(dá) 4.8 Gbps,充分展現(xiàn)了這一全新 USB 接口協(xié)議的廣闊前景。

本次演示的重要意義

當(dāng)一項全新的接口技術(shù)問世時,技術(shù)規(guī)格與仿真驗證僅僅是開始??蛻襞c合作伙伴真正需要的,是確信整個生態(tài)系統(tǒng)能夠在芯片、控制器、物理層、平臺及各類設(shè)備間實際穩(wěn)定運行。

在 CES 2026 展會上,我們通過演示將這份信心變?yōu)楝F(xiàn)實,其核心旨在回答一個簡單問題:eUSB2V2 能否在真實環(huán)境中,以真實系統(tǒng)行為和互操作性實現(xiàn)實際傳輸性能?

我們的答案是:可以,并且在展會現(xiàn)場實時呈現(xiàn)。

演示平臺:

搭載完整 eUSB2V2 系統(tǒng)的設(shè)備端到主機端方案

本次演示系統(tǒng)按照真實應(yīng)用場景構(gòu)建了完整的端到端數(shù)據(jù)流:在設(shè)備端采集視頻,并將數(shù)據(jù)穩(wěn)定傳輸至主機端進(jìn)行處理與顯示。

系統(tǒng)架構(gòu)(概覽):

主機端與設(shè)備端均采用 3nm eUSB2V2 PHY 測試芯片

主機與設(shè)備控制器基于 FPGA 板卡實現(xiàn)

系統(tǒng)中接入 PC/ATX 主板,支撐完整端到端傳輸鏈路

設(shè)備端 PHY 與主機端 PHY 采用 SMA 線纜連接,確保優(yōu)異的信號完整性

主機端連接顯示器,實時展示視頻傳輸畫面

數(shù)據(jù)傳輸流程

高分辨率攝像頭將實時原始數(shù)據(jù)以最大碼率通過 PC/ATX 主板傳入基于 FPGA 的系統(tǒng)。設(shè)備端物理層通過 SMA 線纜與主機端物理層通信;在主機側(cè),F(xiàn)PGA 板卡運行主機控制器,連接至 PC/ATX 主板與顯示器,實時呈現(xiàn)采集到的視頻畫面。

這一流暢的傳輸流程,充分展示了 eUSB2V2 在實際應(yīng)用場景中的高效性與優(yōu)異性能,而非僅僅是實驗室環(huán)境下的驗證。

亮點展示:

基于 eUSB2V2 同時傳輸兩路 4K 視頻流

為了讓系統(tǒng)超越單一理想場景的工作負(fù)載,我們現(xiàn)場演示了兩路視頻源,同時通過 eUSB2V2 從設(shè)備端傳輸至主機端。

014K 實時視頻流(UVC)—— 無損 YUV 格式

一路為 4K 網(wǎng)絡(luò)攝像頭采集的實時視頻,以無損 YUV 格式從設(shè)備端傳輸?shù)街鳈C端。在主機側(cè),系統(tǒng)級芯片對視頻進(jìn)行增強處理,并輸出至顯示器顯示。

采用協(xié)議 / 類:UVC(USB 視頻類)

核心結(jié)論:eUSB2V2 可在不依賴壓縮技術(shù)的前提下,穩(wěn)定承載高要求的實時視頻傳輸。

024K 錄制視頻流(MSC)—— 來自 SSD 的批量傳輸

另一路演示大容量數(shù)據(jù)傳輸:以搭載固態(tài)硬盤的設(shè)備端存儲 4K 錄制視頻,主機系統(tǒng)接收內(nèi)容并在顯示器上播放。

采用協(xié)議 / 類:MSC(大容量存儲類)

核心結(jié)論:eUSB2V2 可在支持實時流媒體的同時,兼顧高吞吐量的大容量數(shù)據(jù)傳輸。

關(guān)鍵支撐技術(shù):

基于 UTMI v2.0 的控制器與物理層橋接方案

本次演示的核心要點之一,是實現(xiàn)了系統(tǒng)各組件之間清晰、準(zhǔn)確的互聯(lián)。

控制器(主機端 + 設(shè)備端):運行于 Cadence FPGA 平臺

3nm 物理層 IP:集成于測試芯片中

橋接 / 接口:全新發(fā)布的 UTMI v2.0(USB 2.0 收發(fā)器宏單元接口)

該接口實現(xiàn)了 FPGA 內(nèi)控制器 IP 與芯片物理層 IP 之間的流暢對接,助力完成整套解決方案的全棧驗證。

本次演示證明:

eUSB2V2 已成為完整解決方案

CES 2026 的此次演示,不僅是一次速度里程碑,更是在系統(tǒng)層面證明了 eUSB2V2 能夠作為一套完整、可互操作的解決方案落地應(yīng)用:

業(yè)內(nèi)首創(chuàng)的 3nm eUSB2V2 物理層 IP(覆蓋主機端與設(shè)備端 PHY)

主機端與設(shè)備端控制器 IP

經(jīng)過實際驗證的實時系統(tǒng),充分展示各組件在真實場景下的協(xié)同工作能力

更為重要的是,本次演示為技術(shù)落地應(yīng)用提供了堅實信心,尤其是實現(xiàn)了以下場景間的無縫互操作:

已獲得頭部客戶授權(quán)的主機端解決方案

生態(tài)內(nèi)各類設(shè)備端方案提供商

展望未來:

消費電子與邊緣 AI 下一代應(yīng)用量身打造

除消費電子領(lǐng)域的連接應(yīng)用外,這一里程碑更彰顯了我們面向邊緣 AI 時代的戰(zhàn)略布局 —— 在分布式智能與高傳感器密度設(shè)備中,帶寬、時延、能效與可靠性將變得愈發(fā)關(guān)鍵。

本次演示不僅展現(xiàn)了當(dāng)下的技術(shù)可行性,更為下一代應(yīng)用的規(guī)?;瘮U展奠定了堅實基礎(chǔ)。

總結(jié)

eUSB2V2 具備現(xiàn)代系統(tǒng)所需的靈活性,融合了高數(shù)據(jù)速率、可配置鏈路選項、低電磁干擾以及低功耗運行等優(yōu)勢。隨著系統(tǒng)級芯片向先進(jìn)工藝節(jié)點演進(jìn),而互聯(lián)設(shè)備仍沿用成熟工藝節(jié)點,eUSB2V2 正迅速成為銜接這一差異的首選 USB 接口,進(jìn)一步拓展成熟且廣泛應(yīng)用的 USB 生態(tài)系統(tǒng)。

Cadence 作為 USB IP 領(lǐng)域的長期領(lǐng)導(dǎo)者,已推出完整的端到端 eUSB2V2 解決方案,涵蓋主機與外設(shè)控制器、物理層、驅(qū)動程序及驗證 IP。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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原文標(biāo)題:CES 2026 回顧:基于真實可用的 eUSB2V2 系統(tǒng)演示,筑牢信任基石

文章出處:【微信號:gh_fca7f1c2678a,微信公眾號:Cadence楷登】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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