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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>PDN設(shè)計(jì)和FPGA收發(fā)器性能

      PDN設(shè)計(jì)和FPGA收發(fā)器性能

      2011-05-11 | pdf | 387 KB | 次下載 | 免費(fèi)

      資料介紹

      ?

      面向收發(fā)器(SERDES) FPGA 的PDN 設(shè)計(jì)對(duì)電源有嚴(yán)格的要求，需要干凈的電壓源。雖然低功耗應(yīng)用中通常采用低泄漏(LDO) 線性穩(wěn)壓器，但這一方法必須仔細(xì)的隔離電壓源。電路板設(shè)計(jì)人員在這些應(yīng)用中必須全面考慮電壓源隔離和電壓源共享問題。隔離度較高時(shí)，會(huì)增加穩(wěn)壓器的數(shù)量，而太多的共享則會(huì)影響性能。如果PDN 穩(wěn)壓不夠，那么，收發(fā)器的性能會(huì)受到很大影響。因此，正確的選擇穩(wěn)壓器和電源配置對(duì)于實(shí)現(xiàn)最佳收發(fā)器性能非常重要。在很多PDN 設(shè)計(jì)中，創(chuàng)新的開關(guān)穩(wěn)壓器相對(duì)于線性穩(wěn)壓器有很大的優(yōu)勢(shì)。而且，F(xiàn)PGA收發(fā)器技術(shù)不斷發(fā)展，在FPGA 中實(shí)現(xiàn)穩(wěn)壓器，從而不再需要使用外部穩(wěn)壓器。
      FPGA 收發(fā)器 PDN
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